數字係統設計與PLD應用(第三版) epub pdf mobi txt 電子書 下載 2024

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內容介紹

基本信息

書名:數字係統設計與PLD應用(第三版)

原價：40.00元

作者:臧春華，蔣璿　編著

齣版社：電子工業齣版社

齣版日期：2009-5-1

ISBN：9787121087271

字數：700000

頁碼：422

版次：1

裝幀：平裝

開本：16開

商品重量：

編輯推薦

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內容提要

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本書為普通高等教育“十一五”國傢級規劃教材。本書闡述數字係統設計方法和可編程邏輯器件PLD的應用技術。引導讀者從一般的數字功能電路設計轉嚮數字係統設計；從傳統的非定製通用集成電路的應用轉嚮用戶半定製的PLD的應用；從單純的硬件設計轉嚮硬件、軟件高度滲透的設計方法。從而瞭解數字技術的新發展、新思路、新器件，拓寬軟、硬件沒計的知識麵，提高設計能力。本書是編者在匯總瞭多年從事數字係統設計和PLD應用技術教學及科研成果的基礎上編寫的，取材豐富，概念清晰，既有較高的起點和概括，也有很好的實用和參考價值。書中軟、硬件結閤恰當，有一定的前瞻性和新穎性。全書文字流暢，圖、文、錶緊密結閤，可讀性強。
本書共8章，每章之後均有豐富的習題供讀者選做。第8章提供10個上機實驗題，供不同層次教學需求和讀者選用。書末有附錄，簡明介紹各種HDPLD典型器件和一種典型PLD開發工具，供讀者參考。
本書可作為高等學校電子信息類、電氣信息類、計算機類各專業的教科書，同時也是上述學科及其他相關學科工程技術人員很好的實用參考書。

目錄

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第1章 數字係統設計方法
　1.1　緒言
1.1.1　數字係統的基本概念
1.1.2　數字係統的基本模型
1.1.3　數字係統的基本結構
1.2　數字係統設計的一般步驟
1.2.1　引例
1.2.2　數字係統設計的基本步驟
1.2.3　層次化設計
1.3　數字係統設計方法
1.3.1　自上而下的設計方法
1.3.2　自下而上的設計方法
1.3.3　基於關鍵部件的設計方法
1.3.4　信息流驅動的設計方法
1.4　數字係統的描述方法之一——算法流程圖
1.4.1　算法流程圖的符號與規則
1.4.2　設計舉例
習題1
第2章　數字係統的算法設計和硬件實現
2.1　算法設計
2.1.1　算法設計綜述
2.1.2　跟蹤法
2.1.3　歸納法
2.1.4　劃分法
2.1.5　解析法
2.1.6　綜閤法
　2.2　算法結構
2.2.1　順序算法結構
2.2.2　並行算法結構
2.2.3　流水綫算法結構
2.3　數據處理單元的設計
2.3.1　係統硬件實現概述
2.3.2　器件選擇
2.3.3　數據處理單元設計步驟
2.3.4　數據處理單元設計實例
　2.4　控製單元的設計
2.4.1　係統控製方式
2.4.2　控製器的基本結構和係統同步
2.4.3　算法狀態機圖(ASM圖）
2.4.4　控製器的硬件邏輯設計方法
　習題2
第3章　硬件描述語言VHDl和VerilogHDl
　3.1　概述
3.2　VHDl及其應用
3.2.1　VHDl基本結構
3.2.2　數據對象、類型及運算符
3.2.3　順序語句
3.2.4　並行語句
3.2.5　子程序
3.2.6　程序包與設計庫
3.2.7　元件配置
3.2.8　VHDl描述實例
　3.3　VerilogHDl及其應用
3.3.1　VerilogHDl基本結構
3.3.2　數據類型、運算符與錶達式
3.3.3　行為描述語句
3.3.4　並行語句
3.3.5　結構描述語句
3.3.6　任務與函數
3.3.7　編譯預處理
3.3.8　VerilogHDl描述實例
習題3
第4章 可編程邏輯器件PlD原理和應用
4.1　PlD概述
4.2　簡單PlD原理
4.2.1　PlD的基本組成
4.2.2　PlD的編程
4.2.3　陣列結構
4.2.4　PlD中陣列的錶示方法
4.3　SPlD組成和應用
4.3.1　隻讀存儲器ROM
4.3.2　可編程邏輯陣列PlA
4.3.3　可編程陣列邏輯PAl
4.3.4　通用陣列邏輯GAl
……
第5章　高密度PLD及其應用
第6章　采用HDPLD設計數字係統實例
第7章　可編程片上係統（SOPC）
第8章　上機實驗
附錄A　HDPLD典型器件介紹
附錄B　PLD開發軟件QuartusII8.0簡介
參考文獻

作者介紹

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文摘

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序言

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關聯推薦
本書可作為高等學校電子信息類、電氣信息類、計算機類各專業的教科書，同時也是上述學科及其他相關學科工程技術人員很好的實用參考書。
目錄
第1章 數字係統設計方法
1.1 緒言
1.1.1 數字係統的基本概念
1.1.2 數字係統的基本模型
1.1.3 數字係統的基本結構
1.2 數字係統設計的一般步驟
1.2.1 引例
1.2.2 數字係統設計的基本步驟
1.2.3 層次化設計
1.3 數字係統設計方法
1.3.1 自上而下的設計方法
1.3.2 自下而上的設計方法
1.3.3 基於關鍵部件的設計方法
1.3.4 信息流驅動的設計方法
1.4 數字係統的描述方法之一算法流程圖
1.4.1 算法流程圖的符號與規則
1.4.2 設計舉例
習題1
第2章 數字係統的算法設計和硬件實現
2.1 算法設計
2.1.1 算法設計綜述
2.1.2 跟蹤法
2.1.3 歸納法
2.1.4 劃分法
2.1.5 解析法
2.1.6 綜閤法
2.2 算法結構
2.2.1 順序算法結構
2.2.2 並行算法結構
2.2.3 流水綫算法結構
2.3 數據處理單元的設計
2.3.1 係統硬件實現概述
2.3.2 器件選擇
2.3.3 數據處理單元設計步驟
2.3.4 數據處理單元設計實例
2.4 控製單元的設計
2.4.1 係統控製方式
2.4.2 控製器的基本結構和係統同步
2.4.3 算法狀態機圖（ＡＳＭ圖）
2.4.4 控製器的硬件邏輯設計方法
習題2
第3章 硬件描述語言VHDL和VerilogHDL
3.1 概述
3.2 VHDL及其應用
3.2.1 VHDL基本結構
3.2.2 數據對象、類型及運算符
3.2.3 順序語句
3.2.4 並行語句
3.2.5 子程序
3.2.6 程序包與設計庫
3.2.7 元件配置
3.2.8 VHDL描述實例
3.3 VerilogHDL及其應用
3.3.1 VerilogHDL基本結構
3.3.2 數據類型、運算符與錶達式
3.3.3 行為描述語句
3.3.4 並行語句
3.3.5 結構描述語句
3.3.6 任務與函數
3.3.7 編譯預處理
3.3.8 VerilogHDL描述實例
習題3
第4章 可編程邏輯器件ＰＬＤ原理和應用
4.1 ＰＬＤ概述
4.2 簡單ＰＬＤ原理
4.2.1 ＰＬＤ的基本組成
4.2.2 ＰＬＤ的編程
4.2.3 陣列結構 ��
4.2.4 ＰＬＤ中陣列的錶示方法��
4.3 ＳＰＬＤ組成和應用
4.3.1 隻讀存儲器RＯＭ �� 4.3.2 可編程邏輯陣列ＰＬＡ
4.3.3 可編程陣列邏輯ＰＡＬ
4.3.4 通用陣列邏輯ＧＡＬ
4.3.5 ＧＡＬ應用舉例
4.4 采用ＳＰＬＤ設計數字係統
4.4.1 采用ＳＰＬＤ實現係統的步驟
4.4.2 設計舉例
4.4.3 采用ＳＰＬＤ設計係統的討論
習題4
第5章 高密度ＰＬＤ及其應用
5.1 ＨＤＰＬＤ分類
5.2 ＨＤＰＬＤ組成
5.2.1 陣列擴展型CＰＬＤ
5.2.2 現場可編程門陣列(ＦＰＧＡ)
5.2.3 延遲確定型FPGA
5.2.4 多路開關型ＦＰＧＡ
5.3 ＨＤＰＬＤ編程技術
5.3.1 在係統可編程技術
5.3.2 在電路配置(重構)技術
5.3.3 反熔絲（Ａntifuse)編程技術
5.4 ＨＤＰＬＤ開發平颱
5.4.1 HDPLD開發係統的基本工作流程
5.4.2 HDPLD開發係統的庫函數
5.5 當前常用可編程邏輯器件及其開發工具
5.5.1 Lattice公司的CPLD/FPGA與開發軟件
5.5.2 Altera公司的CPLD/FPGA及開發工具
5.5.3 Xilinx公司的CPLD/FPGA和開發平颱
5.5.4 用於CPLD/FPGA的IP核
習題5 ��
第6章 采用ＨＤＰＬＤ設計數字係統實例
6.1 高速並行乘法器的設計
6.1.1 算法設計和結構選擇
6.1.2 器件選擇
6.1.3 設計輸入 ��
6.1.4 芯片引腳定義
6.1.5 邏輯仿真
6.1.6 目標文件産生和器件下載
6.2 十字路口交通管理器的設計
6.2.1 交通管理器的功能
6.2.2 係統算法設計
6.2.3 設計輸入
6.3 九九乘法錶係統的設計
6.3.1 係統功能和技術指標
6.3.2 算法設計
6.3.3 數據處理單元的實現��
6.3.4 設計輸入
6.3.5 係統的功能仿真
6.4 ＦＩＦＯ（先進先齣堆棧）的設計
6.4.1 ＦＩＦＯ的功能 ��
6.4.2 算法設計和邏輯框圖
6.4.3 數據處理單元和控製器的設計
6.4.4 設計輸入 ��
6.4.5 用VerilogHDL進行設計
6.4.6 仿真驗證 ��
6.5 數據采集和反饋控製係統的設計
6.5.1 係統設計要求
6.5.2 設計輸入
6.6 ＦＩR有限衝激響應濾波器的設計
6.6.1 FIR結構簡介
6.6.2 設計方案和算法結構
6.6.3 模塊組成 ��
6.6.4 FIR濾波器的擴展應用
6.6.5 設計輸入 ��
6.6.6 設計驗證 ��
6.7 UART接口設計
6.7.1 UART組成與幀格式��
6.7.2 頂層模塊的描述
6.7.3 發送模塊設計
6.7.4 接收模塊設計
6.7.5 仿真驗證
6.8 簡單處理器的設計
6.8.1 係統功能介紹
6.8.2 處理器硬件係統
6.8.3 處理器指令係統
6.8.4 處理器硬件係統的設計和實施
6.8.5 設計輸入
6.8.6 係統功能仿真
習題6 ��
第7章 可編程片上係統(SOPC)
7.1 概述��
7.2 基於MicroBlaze軟核的嵌入式係統
7.2.1 Xilinx的SOPC技術
7.2.2 MicroBlaze處理器結構
7.2.3 MicroBlaze信號接口
7.2.4 MicroBlaze軟硬件設計流程
7.3 基於NiosⅡ軟核的SOPC
7.3.1 Altera的SOPC技術
7.3.2 NiosⅡ處理器
7.3.3 Avalon總綫架構
7.3.4 NiosⅡ軟硬件開發流程
7.4 設計實例 ��
7.4.1 設計要求 ��
7.4.2 運行QuartusⅡ並新建設計工程
7.4.3 創建一個新的SOPCBuilder係統
7.4.4 在SOPCBuilder中定義NiosⅡ係統
7.4.5 在SOPCBiulder中生成NiosⅡ係統
7.4.6 將NiosⅡ係統集成到QuartusⅡ工程中 ��
7.4.7 用NiosⅡIDE開發軟件
習題7 ��
第8章 上機實驗
實驗1 邏輯門實現組閤電路
一、實驗目的 ��
二、實驗內容 ��
三、注意事項
實驗2 數據選擇器或譯碼器實現組閤電路 ��
一、實驗目的
二、實驗原理 ��
三、實驗內容
四、注意事項 ��
實驗3 碼製變換器 ��
一、實驗目的 ��
二、實驗內容 ��
三、注意事項 ��
實驗4 序列發生器 ��
一、實驗目的 ��
二、實驗原理 ��
三、實驗內容 ��
四、注意事項
實驗5 序列檢測器
一、實驗目的
二、實驗原理 ��
三、實驗內容
實驗6 控製器的設計 ��
一、實驗目的
二、實驗原理 ��
三、實驗內容 ��
實驗7 脈衝分配器
一、實驗目的 ��
二、實驗原理 ��
三、實驗內容 ��
實驗8 十字路口交通管理器
一、實驗目的
二、實驗內容 ��
三、實驗要求 ��
實驗9 UART接口設計
一、實驗目的 ��
二、實驗內容
實驗10 簡單處理器VHDL設計的完成 ��
一、實驗目的
二、實驗內容
三、實驗要求
附錄A ＨＤＰＬＤ典型器件介紹
A.1 器件封裝形式說明
A.2 Altera公司典型器件
A.3 Xilinx公司典型器件
A.4 Lattice公司典型器件
A.5 Actel公司典型器件
附錄B PLD開發軟件QuartusⅡ8.0簡介
B.1 概述
B.2 用QuartusⅡ進行設計的一般過程
B.3 設計輸入
B.4 編譯
B.5 仿真驗證 ��
B.6 時序分析 ��
B.7 底層圖編輯
B.8 下載
B.9 “Settings”對話框
B.10 QuartusⅡ中的庫元件
參考文獻

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