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内容介绍

基本信息

书名:EDA技术与实践教程(含光盘1张)

原价：26.00元

作者:宋烈武 编著

出版社：电子工业出版社

出版日期：2009-8-1

ISBN：9787121091018

字数：340000

页码：199

版次：1

装帧：平装

开本：16开

商品重量：

编辑推荐

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任务驱动，行动导向，工学结合，学生主体，过程考核。

内容提要

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本书提供了参考授课计划及自学建议；第1章概述了EDA技术的主要内容；第2章简要介绍了FPGA/CPLD的结构与工作原理及其配置与编程方法；第3章介绍了Quartus Ⅱ设计流程及6个设计实例；第4章介绍了硬件描述语言VHDL语法概要；第5章用VHDL给出了常用单元电路的设计；第6章由浅入深精选了6个基础训练项目；第7章精选了6个综合训练项目。本教材提供的所有VHDL代码均在Altera推广型开发工具Quartus Ⅱ 9.0 SP1上综合通过，部分例题给出了仿真结果，另附Quartus Ⅱ开发工具及相关资料DVD光盘一张。
本书可作为各高职院校电子类、通信类及计算机类等相关专业二年级及以上学生的教材，也可作为电子技术工程技术人员的参考用书。

目录

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第一篇 EDA技术基础
第1章 概述
1.1 EDA技术的含义
1.2 EDA技术的主要内容
1.3 EDA技术的特点及发展趋势
第2章 可编程逻辑器件
2.1 概述
2.2 大规模可编程逻辑器件
2.3 Altera新型系列器件简介
2.4 FPGA/CPLD器件的配置与编程
第3章 QuartusⅡ设计基础
3.1 概述
3.2 QuartusⅡ的安装与授权
3.3 QuartusⅡ设计流程
3.4 QuartusⅡ设计实例
第4章 硬件描述语言VHDL语法概要
4.1 概述
4.2 VHDL程序基本结构
4.3 VHDL语言要素
4.4 VHDL的基本描述语句
4.5 子程序、程序包和配置
第5章 常用模块电路的VHDL设计
5.1 常用组合逻辑电路的设计
5.2 时序逻辑电路的设计
5.3 状态机的设计
5.4 存储器的设计
第二篇 实战训练
第6章 基础训练
6.1 一位全加器原理图输入设计
6.2 译码显示电路的设计
6.3 含异步清零和同步时钟使能的４位加法计数器的设计
6.4 数控分频器的设计
6.5 用状态机实现序列检测器的设计
6.6 简易正弦信号发送器的设计
第7章 综合训练
7.1 键盘输入电路的设计
7.2 动态输出4位十进制频率计的设计
7.3 数字钟的设计
7.4 DDS信号源的设计
7.5 基于Dsp Builder使用IP Core的FIR滤波器的设计
7.6 基于NiosⅡ的SD卡音乐播放器的实现
附录
A.DE2基本资料
B.基于MAXⅡ EPM240芯片的WZ型最小系统实验板基本资料
C.FPGA/CPLD主要厂商及开发工具简介
参考文献

作者介绍

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文摘

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序言

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关联推荐
本书可作为高职院校电子类、通信类及计算机类等相关专业的教材，也可作为电子技术工程人员的参考用书
目录
第一篇 EDA技术基础
第1章 概述
1.1 EDA技术的含义
1.2 EDA技术的主要内容
1.3 EDA技术的特点及发展趋势
第2章 可编程逻辑器件
2.1 概述
2.1.1 可编程逻辑器件的发展历程
2.1.2 简单可编程逻辑器件的基本结构
2.1.3 可编程逻辑器件的主要分类
2.2 大规模可编程逻辑器件
2.2.1 FPGA的结构与工作原理
2.2.2 CPLD的结构与工作原理
2.2.3 其他类型的FPGA和CPLD
2.2.4 Altera成熟器件及命名规则
2.2.5 FPGA和CPLD的开发应用选择
2.2.6 Altera配置芯片简介
2.3 Altera新型系列器件简介
2.3.1 Stratix系列高端FPGA简介
2.3.2 Arria系列中端FPGA简介
2.3.3 Cyclone系列低端FPGA简介
2.3.4 MAX Ⅱ系列低成本CPLD简介
2.3.5 HardCopy ASIC系列简介
2.4 FPGA/CPLD器件的配置与编程
2.4.1 下载电缆
2.4.2 配置与编程模式
2.4.3 配置方式
第3章 QuartusⅡ设计基础
3.1 概述
3.2 QuartusⅡ的安装与授权
3.3 QuartusⅡ设计流程
3.4 QuartusⅡ设计实例
3.4.1 输入设计与编译
3.4.2 仿真及时序分析
3.4.3 下载实现及硬件测试
3.4.4 可参数化宏模块的调用
3.4.5 Dsp Builder的应用
3.4.6 设计一个简单的CPU系统
第4章 硬件描述语言VHDL语法概要
4.1 概述
4.1.1 VHDL的特点
4.1.2 学习VHDL的注意事项
4.2 VHDL程序基本结构
4.2.1 库
4.2.2 实体
4.2.3 结构体
4.3 VHDL语言要素
4.3.1 文字规则
4.3.2 数据对象
4.3.3 数据类型
4.3.4 类型转换
4.3.5 运算操作符
4.3.6 属性
4.4 VHDL的基本描述语句
4.4.1 顺序语句
4.4.2 并行语句
4.4.3 其他语句
4.5 子程序、程序包和配置
4.5.1 子程序
4.5.2 程序包
4.5.3 配置
第5章 常用模块电路的VHDL设计
5.1 常用组合逻辑电路的设计
5.1.1 七段译码器
5.1.2 优先编码器
5.1.3 多路选择器
5.1.4 求补器
5.1.5 三态门及总线缓冲器
5.2 时序逻辑电路的设计
5.2.1 触发器的设计
5.2.2 移位寄存器的设计
5.2.3 计数器的设计
5.3 状态机的设计
5.3.1 摩尔状态机的设计
5.3.2 米里状态机的设计
5.4 存储器的设计
5.4.1 只读存储器的设计
5.4.2 随机存储器的设计
5.4.3 堆栈的设计
第二篇 实战训练
第6章 基础训练
6.1 一位全加器原理图输入设计
6.2 译码显示电路的设计
6.3 含异步清零和同步时钟使能的４位加法计数器的设计
6.4 数控分频器的设计
6.5 用状态机实现序列检测器的设计
6.6 简易正弦信号发送器的设计
第7章 综合训练
7.1 键盘输入电路的设计
7.2 动态输出4位十进制频率计的设计
7.3 数字钟的设计
7.4 DDS信号源的设计
7.5 基于Dsp Builder使用IP Core的FIR滤波器的设计
7.6 基于NiosⅡ的SD卡音乐播放器的实现
附录
A．DE2基本资料
B．基于MAXⅡ EPM240芯片的WZ型最小系统实验板基本资料
C．FPGA/CPLD主要厂商及开发工具简介
参考文献

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