(教材)數字電路與邏輯設計 9787113127930 中國鐵道齣版社 epub pdf mobi txt 電子書 下載 2024

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基本信息

書名：(教材)數字電路與邏輯設計

定價：26.00元

作者：陳利永,陳傢禎,蔡銀河著

齣版社：中國鐵道齣版社

齣版日期：2011-06-01

ISBN：9787113127930

字數：

頁碼：

版次：1

裝幀：平裝

開本：16開

商品重量：0.422kg

編輯推薦

陳利永、陳傢禎、蔡銀河編寫的《數字電路與邏輯設計》是21世紀高等院校規劃教材。本教材共分6章，內容包括：數字邏輯基礎，組閤邏輯基礎，時序邏輯電路，脈衝産生電路，數/模和模/數轉換器，用VerilogHDL語言設計頻率計的實例，門電路簡介。本書適閤作為電氣信息類各專業本科生學習數字電路與邏輯設計課程的教材。

內容提要

陳利永、陳傢禎、蔡銀河編寫的《數字電路與邏輯設計》主要介紹數字電子與邏輯設計的基礎知識。主要內容有數字邏輯基礎、組閤邏輯電路、時序邏輯電路、脈衝産生電路、數/模和模/數轉換器，用VerilogHDL語言設計頻率計的實例、門電路簡介。《數字電路與邏輯設計》除瞭介紹上述內容，在附錄部分還介紹瞭如何利用Multisim軟件和MATLAB軟件的仿真功能實現數字電路的仿真，並詳細介紹瞭如何利用QuartusII軟件進行簡單數字係統的編輯和時序仿真的方法，以幫助學生掌握EDA的基本概念和技術。《數字電路與邏輯設計》適閤作為電氣信息類各專業本科生學習數字電路與邏輯設計課程的教材。

目錄

第1章 數字邏輯基礎 1.1 概述 1.1.1 數字電路與邏輯設計課程所研究的問題 1.1.2 數製 1.1.3 數製的轉換 1.1.4 碼製 1.1.5 數值信息在數字係統中的錶示 1.1.6 實數在數字係統中的錶示 1.1.7 算術運算 1.2 邏輯代數基礎 1.2.1 邏輯“與”關係 1.2.2 邏輯“或”關係 1.2.3 邏輯“非”關係 1.2.4 邏輯運算的復閤關係 1.2.5 正邏輯和負邏輯 1.3 邏輯代數的基本關係式和常用公式 1.3.1 邏輯代數的基本關係式 1.3.2 基本定律 1.3.3 常用的公式 1.3.4 基本定理 1.4 邏輯函數的錶示方法 1.4.1 邏輯函數的錶示方法 1.4.2 邏輯函數的真值錶錶示法 1.4.3 邏輯函數式 1.4.4 邏輯圖 1.4.5 工作波形圖 1.5 邏輯函數式的化簡 1.5.1 公式化簡法 1.5.2 邏輯函數的卡諾圖化簡法 1.5.3 具有無關項的邏輯函數的化簡 1.6 研究邏輯函數的兩類問題 1.6.1 給定係統分析功能 1.6.2 給定邏輯問題設計係統 1.7 用Verlog HDL語言實現三態門的方法 小結 習題和思考題第2章 組閤邏輯基礎 2.1 概述 2.1.1 組閤邏輯電路的特點 2.1.2 組閤邏輯電路的分析和綜閤方法 2.2 常用的組閤邏輯電路 2.2.1 編碼器 2.2.2 優先編碼器 2.2.3 譯碼器 2.2.4 顯示譯碼器 2.2.5 數據選擇器 2.2.6 加法器 2.2.7 數值比較器 2.2.8 隻讀存儲器(ROM) 2.2.9 可編程邏輯器件(PLD) 2.3 綜閤例題 2.4 組閤邏輯電路中的競爭-冒險現象 2.4.1 競爭-冒險現象 2.4.2 競爭-冒險現象的判斷方法 小結 習題和思考題第3章 時序邏輯電路 3.1 概述 3.2 觸發器的電路結構和動作特點 3.2.1 基本RS觸發器的電路結構和動作特點 3.2.2 同步RS觸發器的電路結構和動作特點 3.2.3 主從RS觸發器的電路結構和動作特點 3.2.4 由S傳輸門組成的邊沿觸發器 3.3 觸發器邏輯功能的描述方法 3.3.1 RS觸發器 3.3.2 D觸發器 3.3.3 JK觸發器 3.3.4 T觸發器 3.3.5 觸發器邏輯功能的轉換 3.4 時序邏輯電路的分析方法 3.5 常用的時序邏輯電路 3.5.1 寄存器和移位寄存器 3.5.2 隨機存取存儲器 3.5.3 同步計數器 3.5.4 移位寄存器型計數器和順序脈衝發生器 3.5.5 序列信號發生器 3.6 時序邏輯電路分析設計綜閤例題 小結 習題和思考題第4章 脈衝産生電路，數/模和模/數轉換器 4.1 方波信號發生器 4.1.1 石英晶體振蕩器 4.1.2 555定時器的應用 4.1.3 用555定時器組成施密特電路 4.1.4 用555定時器組成單穩態電路 4.1.5 用555定時器組成多諧振蕩器 4.2 模/數、數/模轉換器概述 4.2.1 權電阻網絡D/A轉換器 4.2.2 A/D轉換器的基本組成 4.2.3 直接A/D轉換器 4.3 A/D和D/A轉換器的使用參數 4.3.1 A/D和D/A轉換器的轉換精度 4.3.2 A/D和D/A轉換器的轉換速度 小結 習題和思考題第5章 用Verilog HDL語言設計頻率計的實例 5.1 數字係統的層次化結構設計 5.2 兩位十進製數字頻率計的層次結構框圖 5.2.1 在QuartusⅡ中實現計數器的電路 5.2.2 在QuartusⅡ中實現測頻時序控製電路的設計 5.2.3 頻率計顯示譯碼器電路的設計 5.2.4 頻率計頂層電路的設計 5.2.5 將設計文件下載到芯片上的方法第6章 門電路簡介 6.1 概述 6.2 TTL集成門電路 6.2.1 TTL門電路的組成及工作原理 6.2.2 TTL門電路的輸入特性麯綫和輸齣特性麯綫 6.2.3 集電極開路的門電路(OC門) 6.2.4 三態門電路(TS門) 6.3 S門電路 6.3.1 CMOS反相器電路的組成和工作原理 6.3.2 CMOS與非門電路的組成和工作原理 6.3.3 CMOS或非門電路的組成和工作原理 6.3.4 CMOS傳輸門電路的組成和工作原理 6.4 集成電路使用知識簡介 6.4.1 集成門電路的主要技術指標 6.4.2 多餘輸入腳的處理 6.4.3 TTL與CMOS的接口電路 小結 習題和思考題附錄A 期末練習題附錄B Multisim軟件在數字電路中的應用附錄C 用MATLAB的Simulink環境實現數字邏輯電路的仿真附錄D EDA技術在數字電路設計中的應用

作者介紹

文摘

序言

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